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[仿真讨论] 这个PCI-E差分信号的电阻是如何接的?

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1#
发表于 2011-12-25 10:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如手册里说的几个100欧的差分电阻是怎么接的? 这里差分线的PULL DOWN ,PULL UP指什么?
6 G5 y3 J; `) [4 E+ h

该用户从未签到

2#
发表于 2012-1-7 16:00 | 只看该作者
这里的100ohm是指PCIE2的100ohm差分阻抗,上下拉是指CML电路内部已经匹配好的电路,你做PCB设计不用关心那个。这个PCIE带了均衡和加重。* k0 c  \. q  a5 p

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jiangchun9981 + 2 赞一个!
forevercgh + 10 赞一个!

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该用户从未签到

3#
 楼主| 发表于 2012-1-12 10:31 | 只看该作者
非常感谢! 查找过很多资料了,特别找到是TI关于电平匹配方面到文档,确实是如2楼说的,可以直接链接就可以了。芯片(in chip)内部已经有匹配电阻了。
  • TA的每日心情
    开心
    2021-10-15 15:16
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    [LV.1]初来乍到

    4#
    发表于 2012-2-1 11:26 | 只看该作者
    ,确实如此!3 [8 P& \" @4 V5 B( f; s' u, h/ g( L
    如果hw design需要注意的地方,pdf会详细说明的
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