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[Cadence Sigrity] 请教噪声容限的测量问题

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发表于 2011-12-5 15:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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最近在学习cadence的仿真,对《cadence高速电路板设计与仿真》一书中的噪声容限的测量不是很理解,请求熟悉的人详细解释指导一下。谢谢了。" L6 [( C$ u0 P
问题如下:1.报告中的值与测量值有一些差距,实际以哪个为准?
% T! K+ M  S( J) ~          2.margin发生在high side还是low side,是什么意思?! ?$ E. h/ _( I2 e5 L
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