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求解用PADS Logic 生成的网络表的问题

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发表于 2011-11-9 19:54 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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padsnet.err——记事本
  \  q5 f8 O! V2 m" m6 p/ G# G1 G' f/ [$ F  v2 i! `  w1 c
PCB Net List Errors Report - DOTLED1.sch - Wed Nov 09 19:45:31 2011
. K, Q: ]  [* _- n% T! t. \* v--------------------------------------------------------------------8 i( t; i6 c2 `  s
Design to Library Part Consistency Check
6 r& h! O2 C3 {9 A# x* {8 [# [9 X----------------------------------------! E  a7 {8 s3 E
No Library consistency checking errors.
4 b& y8 s  L. k- H: ^2 e8 E( N# C$ c  M) A( q! Z  w
Single/Zero Pin Net Warnings" H9 y8 g( O$ W! X0 K  }$ ^# g: `
----------------------------
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0 g/ @9 P2 n2 \; h$ Z- l  w
Schematic Connectivity Errors
1 Z( M; s! N7 C7 K-----------------------------
  b$ G  a9 ?9 ?( ^8 b' Q. l/ Q( K2 V
Dangling Connections without a Net Name' c. t8 s6 R  X
) a% u, S  F2 w7 o4 N, ^( @( V
H89 ]; y' w' Q8 R* a% j
Sheet 1      X5010  Y11270
1 s, ?) _/ t$ |# Y" l$ [+ P
) c# v+ V+ b+ Q) D, Y" o; z4 CDangling Connections with a Net Name
4 G" X9 f( F) L7 |
7 O0 W& V% X7 O) D6 M& wH107 m. t1 X" Y* ~2 b
Sheet 1      X4270  Y9790
$ U. h& f: i/ q9 m' ^( u. ~
7 G7 I' e1 F& T: v0 g请好心人解释上面是那出现问题了。。。。。。

QQ截图20111109194730.png (13.11 KB, 下载次数: 5)

QQ截图20111109194730.png

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2#
发表于 2011-11-10 08:44 | 只看该作者
X5010  Y112709   n# @7 k2 B; T4 |, i
X4270  Y9790 * e) n' z2 O8 o8 K" Z& Q

2 R" l% Z2 I' o& x/ z* y# _查看一下这两个坐标值的地方,存在dangling connect

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3#
发表于 2011-11-10 09:20 | 只看该作者
这两个网点刚好互相连接错误,我以前也遇到过,检查封装和原理图,建议用ORCAD画原理图导网表,logic画元件封装费力。

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4#
 楼主| 发表于 2011-11-11 19:07 | 只看该作者
谢谢大侠,问题已解~

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5#
发表于 2011-12-14 00:21 | 只看该作者
楼主的问题是怎么解决的?我也遇到了,说说啊
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