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本帖最后由 dragongfly 于 2022-7-20 09:57 编辑
( v3 O3 Y' A! X5 I. l: h0 y! [0 T0 I9 q0 T( e1 f
Xilinx 7系列FPGA收发器向导自动执行创建HDL封装器的任务,以配置Artix-7、Kintex™-7 和 Virtex®-7 FPGA 中的高速串行收发器。菜单驱动的界面允许用户配置一个或多个 更多收发器使用适用于流行行业标准的预定义模板,或通过使用自定义模板来支持各种自定义协议。 该向导生成一个包装器、一个示例设计和一个测试平台,用于快速集成和验证串行接口与您的自定义功能。向导生成一个包装器,为自定义应用程序实例化一个或多个正确配置的收发器。* i/ s9 X" ?3 s- Y
, X4 e- Q8 {; A% p) {3 C& b' Q* M5 H% w- [+ \" g: r
特征( Y9 F& a" y- Q$ A- G" i
• 创建定制的 HDL 封装器来配置 Kintex-7 和 Virtex-7 FPGA 中的收发器; @& L1 E- N) n5 R1 A# }! m) i
• 预定义模板自动化行业标准协议的收发器配置。GTX 收发器支持:! N( G0 r% m' o1 H) I4 u2 N1 G
- 通用分组无线接口 (CPRI™):0.6、1.2、2.4、3.072、4.9、6.144 和 9.83 Gb/s" b" M, h& `5 w: P3 ^
- OC-48:2.488 Gb/s
. S% _& p& S* _7 Q1 l- OC-192:9.956 Gb/s8 \+ U$ e# `" o
- 千兆以太网:1.25 Gb/s
! H0 M' Q/ I, l. C: D- 极光 64B/66B:12.5 Gb/s
^: @6 i4 Z; j1 G, s- 极光 8B/10B:6.6 Gb/s1 {: Z+ Z+ Y& ? d* z) R* Y
- PCI Express® Gen1:2.5 Gb/s
5 O5 X* o& O. a+ w8 f: }- PCI Express Gen2:5 Gb/s
. l3 r2 m0 F6 \' B8 k- 显示端口:1.620、2.7、5.4 Gb/s
7 @# x. |6 n, Z+ R7 ^- 10GBASE-R:10.3125 Gb/s: d" \' x) s" V. h `0 q- _
- 因特拉肯:4.25、5.0、6.25 Gb/s
; B* D2 E# C( a& B" \% d5 i- 开放基站架构计划 (OBSAI):3.072 Gb/s- S7 p# z1 a! P# R4 n# ]% U
- OBSAI:6.144 Gb/s8 r3 C& p4 L: I# D) P g: H1 J& C
- 10 Gb 连接单元 (XAUI):3.125 Gb/s
1 T! z' k: h% J: T- m- 10 Gb 精简连接单元 (RXAUI):6.25 Gb/s& n3 c x! j2 D' I& G
- 串行 RapidIO Gen1:1.25、2.5、3.125 Gb/s8 V3 K1 P" O+ U6 d$ b! f, G
- 串行 RapidIO Gen2:5.0、6.25 Gb/s
& }) j3 n! i# o: `4 Q- JESD204:3.0、6.0 Gb/s" o/ J. U5 L! J. X* g
- 100 Gb 连接单元接口 (CAUI):10.3125 Gb/s8 r8 K Z. p% e8 Q
- 10GBASE-KR:10.3125 Gb/s
6 D. t8 F5 A( h% n, d1 B( G( [5 y2 {) }- 通用电气接口 (CEI) 6G-SR:4.976–6.375 Gb/s
" O$ w+ `% [% K2 O, u+ b, ^- 40 Gb 连接单元接口 (XLAUI):10.3125 Gb/s
8 P( M' K I/ A |' x& o8 h& X* G- 四路串行千兆媒体独立接口 (QSGMII):5 Gb/s
3 d" a; [% E( ~" r" O; w- 高清串行数字接口 (HD-SDI)/3 Gb/s
' q( J. c, }- u- a+ A6 T6 X串行数字接口 (3G-SDI):1.485/2.97 Gb/s
. l3 M8 j, y% j3 X3 `; o+ v, c" X- {) l) i( d
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