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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › 请问有谁用过ALTERA的CPLD吗 ?
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请问有谁用过ALTERA的CPLD吗 ?

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twel2e

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1#
发表于 2022-6-17 10:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问有谁用过ALTERA的cpld吗 当CPLD的引脚设置为输入时候，可以内部上拉吗？
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oewqe

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2#
发表于 2022-6-17 11:16 | 只看该作者
FPGA没有上拉的，需要在外部上拉，一般10K左右就可以了
3 L5 F, }) f% i3 F6 W

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mqerew

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3#
发表于 2022-6-17 13:09 | 只看该作者
用过，不可以的8 I$ N+ ?$ M5 X, d% R

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ESCAPE

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4#
发表于 2022-6-17 13:24 | 只看该作者
想看一下别人是怎么说的
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