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FPGA I/O引脚直连 有没有延迟?

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  • TA的每日心情
    开心
    2022-1-24 15:10
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
    发表于 2022-5-19 13:58 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    将任意两个I/O引脚直连,中间不接缓冲器,有没有延迟? 中间连接一个反相器与连接三个反相器的延迟应该相差3倍,为什么仿真结果延迟是一样的?我是新手,求解答,谢谢!系统是默认设置的。
    ) D4 j# A' u/ N

    该用户从未签到

    2#
    发表于 2022-5-19 15:10 | 只看该作者
    说明是有延时
    $ a! T! O0 x$ j" h6 I与I/O端口分配到引脚的模式有关吧
  • TA的每日心情
    开心
    2022-1-21 15:08
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
    发表于 2022-5-19 15:30 | 只看该作者
    外部的延迟不属于仿真软件负责范围,若真要考虑延迟,需要你自己给出延迟。

    该用户从未签到

    4#
    发表于 2022-5-19 16:43 | 只看该作者
    信号经过传输线都需要花时间的,都有时延,信号传输快,时延很小也是有的,比如RS485和RS232线太长了信号就传不到了,超过一定距离无法通信

    该用户从未签到

    5#
    发表于 2022-5-19 19:07 | 只看该作者
    你说的是逻辑上实现assign a=b;+ Q; j' F- d+ \. A( H
    还是layout上将两个PIN连接起来。
    * k% I4 g4 a. h6 L9 G2 w如果是逻辑实现,我一般不考虑延时。; o! D2 B+ E! n0 i! P5 b
    如果是layout的问题,就要看线有多长。但是一般只有高速信号考虑。' b$ R5 z/ `4 E" ]% s, }1 ?

    8 `( Z( z3 k2 G  X7 |, X
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