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[HyperLynx] 有关LPDDR4 模型的理解

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1#
发表于 2022-3-7 13:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在进行LPDDR4X批量仿真时通常会配置ODT模型,其中有几个不太理解,
- {, @3 F7 q1 D1.CPU端写数据时,CPU端通常上拉电阻和下拉电阻的选择目的是输出电压调整?还是其他目的?$ I3 C- x% U7 }+ f; K
2.CPU端读数据时,DRAM端配置下拉的目的是什么?& {# Y' G1 M5 @( N, R5 U
3.VOH = 0.6*VDDQ和 VOH = 0.5*VDDQ这两个模型区别是什么?,可以理解成输出高电平第一个为0.36V,第二个为0.3V?7 g( q/ U7 W$ f- M! `
  d5 s6 D+ n/ p, @# @$ D6 I

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2#
发表于 2022-3-7 16:08 | 只看该作者
看大佬怎么说的
. z' A4 U: C1 _) g

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3#
 楼主| 发表于 2022-3-7 16:39 | 只看该作者
刚咨询了三星的FAE,说是为了调整输出电压,到达一个最好的结果,可以批量仿真获取一个最优值。

点评

能说的详细点吗?想知道  详情 回复 发表于 2022-7-8 13:59

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4#
发表于 2022-7-8 13:59 | 只看该作者
haoyuezhao 发表于 2022-3-7 16:39
  ]3 y  e! N' G7 x$ C1 `, f刚咨询了三星的FAE,说是为了调整输出电压,到达一个最好的结果,可以批量仿真获取一个最优值。

% M; Y5 \+ C( S/ I% ]# z/ L: x能说的详细点吗?想知道
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