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做FPGA设计有必要学习System Verilog？

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qian211111
  • TA的每日心情
    开心
    2022-1-21 15:22

    • 签到天数: 1 天

    [LV.1]初来乍到
    跳转到指定楼层
    1#
    发表于 2022-2-24 10:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    感觉System  Verilog是做ASIC用的，普通做一些FPGA的嵌入式方向需要学习SystemVerilog吗？/ l" K; N5 R* X& H

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    EDA365微信号及QQ群号！
    lrene

    该用户从未签到
    2#
    发表于 2022-2-24 10:27 | 只看该作者
    ) ~* b( f; c* J* e
    大家都用verilog，vhdl吧

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    replace
  • TA的每日心情
    开心
    2022-1-21 15:21

    • 签到天数: 1 天

    [LV.1]初来乍到
    3#
    发表于 2022-2-24 10:49 | 只看该作者
    做fpga应用的好像没看到有用systemverilog的，倒是做asic验证用这个东西吧，

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