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两个PCB合并,器件和布线各用一半,怎么操作?

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1#
发表于 2011-8-10 13:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 cccccc32 于 2011-8-11 17:05 编辑
( I1 g( V# b: D7 e( x* }8 Y
+ t4 t# N1 I4 d. k" [; F大家好!# }4 q+ [; p9 j( `3 |
2 f0 A7 Y2 p; y
      如题,两个PCB中的器件和连线有都各有一半与新的PCB一致,想合并到一起。目前是新建一个PCB,把两个都放进新的PCB中可以,但是把其中一个放进另一个pcb中就导致直接allegro关闭,没有提示错误。请问该怎么解决? 谢谢!!!
8 I7 E8 |: U3 O3 R  q2 g& R0 F

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2#
发表于 2011-8-10 13:36 | 只看该作者
这个MS要先把原理图整合好 ~~  (需要的那部分net和元件的ref都要一直)之后导入网络表,在执行sub-drawing (元件和走线一起过去,注意勾选保持元件refdes选项。GOOD LUCK!" R+ u: t+ V' M, Z0 E$ Q

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cccccc32 + 5

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3#
 楼主| 发表于 2011-8-10 13:38 | 只看该作者
回复 art_li 的帖子
% M/ Q: a, ~& i' s0 t: J5 @3 g4 [$ i
; U  A) Z6 v5 s3 C- b. I" |ok 我试试,非常感谢高人的指点!6 n7 g) A( u8 H/ v6 z

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4#
 楼主| 发表于 2011-8-10 13:44 | 只看该作者
回复 art_li 的帖子
) W% c/ Y. \, G: f3 L
- i6 W, h8 ^( B! ]+ [0 J请问是新建一个PCB之后导入新的网表,还是把网标导入合并其中之一的PCB呢? 谢谢!

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5#
发表于 2011-8-10 13:54 | 只看该作者
回复 cccccc32 的帖子
: [9 i" e1 k3 o+ ]& U6 h, R% J* w" a: w, S" A, c) b9 c
都一样 后者貌似可以少导出个sub-drawing  ,线路图一定要整合好别多了少了,导致功能问题 ,小心~

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6#
 楼主| 发表于 2011-8-10 13:58 | 只看该作者
回复 art_li 的帖子
- M; H4 N+ a0 C9 r
1 B1 T/ w3 g& w, s好的,我再试试,谢谢!
# W2 ], B9 P+ ~4 P1 c" y$ P& L# `

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7#
发表于 2011-8-10 14:03 | 只看该作者
本帖最后由 陈丽 于 2011-8-10 14:04 编辑
& x& L$ V1 K2 Y) R) ^- Q' a- l& \8 E, y' Q
随便用一个PCB当主板,删除另一半的器件后,再用 Reues 功能将器件和线贴过去就可以了。

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8#
 楼主| 发表于 2011-8-10 14:07 | 只看该作者
回复 陈丽 的帖子
/ }8 S5 y3 `' p
8 Z0 `' `8 e8 h; z你好!
, E- T5 G" p; h2 }4 Q/ c     谢谢指点,我用的是15.5版本的,没用过您说的reues,请问这个功能15.5有吗?如果有在哪,谢谢!
% f+ L7 e8 s$ \: q1 ]

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9#
 楼主| 发表于 2011-8-10 14:33 | 只看该作者
回复 art_li 的帖子! F" ~0 ^" s3 |& q

1 c% w+ R1 {0 Q0 d% i1 \9 ?, B你好!4 f  {9 Y. j" A* K( R" L( F! U$ W

0 q, E, n6 L7 H9 r. n     在打扰一下,我试着把第一个PCB用subdrawing导入第二个PCB中,第二个PCB在导入第一个PCB的subdrawing前我先导入了新的网表,这样的方式都会出错,allegro直接就关闭了。这个方法没成功,不知道怎么回事?请再指点一下,谢谢!: J/ v: B+ I8 f4 y

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10#
 楼主| 发表于 2011-8-10 14:38 | 只看该作者
回复 art_li 的帖子
6 B$ Y% S0 I4 @7 Y' s: x. O5 ?  P6 Z! c  Q7 a/ m0 k( O4 ]
我在一个PCB中导入新的net,然后再把另一个PCB放进来,但还是同样提示是allegro运行错误,直接就给关了。悲哀!!!, l* t9 p6 z- \! M% |4 e8 K1 s) n) n
& U, p7 @# q8 R) {; E

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11#
发表于 2011-8-10 14:47 | 只看该作者
回复 cccccc32 的帖子; s  N. s4 y# x9 `9 D+ O
3 V6 r  g2 C4 X$ W  L0 N0 ^
不会吧~这个不好说~  1.原理图的网络表能正常导入吗?2.你的零件库里有这个板子的零件封装吗~?3.呵呵应该有outline吧。。。你的情况挺复杂  ,不会如此啊~!!
; ^% E8 p1 V; e# K5 N  m  N) G1 y/ p6 i9 b! F# {- |

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12#
发表于 2011-8-10 14:50 | 只看该作者
路径上没有中文吧~? 有错误报表吗·····

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13#
 楼主| 发表于 2011-8-10 14:51 | 只看该作者
回复 art_li 的帖子
9 n/ d% I9 x) j  J8 k1 {
" ?  W8 g7 S5 x5 R* d谢谢您的分析,我再试试。 谢谢!
6 ~% q, ^) C. O

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14#
 楼主| 发表于 2011-8-10 14:52 | 只看该作者
回复 art_li 的帖子: }7 O' o" d( `) @: B& q
5 G7 N& l2 z4 a6 v. g
你好!
$ w5 [- N( `; n; e; z     路径上没中文,没错误报表,而且网表也没问题。器件的封装都有。
) e% j( n( \# H$ [5 o- a3 I

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15#
发表于 2011-8-10 14:54 | 只看该作者
那我投降~ 怎么会这个样子~
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