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芯片堆叠技术在SiP中应用的非常普遍，通过芯片堆叠可以有效降低SiP基板的面积，缩小封装体积。6 {6 V- ^, D% P/ v: S/ j' l2 \
) `6 S8 Z2 v" P- i) n& F* B 芯片堆叠的主要形式有四种：0 X/ ?% N: S. T
金字塔型堆叠
& n9 ?" r- L+ W* i 悬臂型堆叠7 F$ f8 X+ |, e$ ^5 F E
并排型堆叠( F% D( N5 x6 o. b' h
硅通孔TSV型堆叠
9 S- {* r4 K/ E5 l! g5 n" }% F 为什么芯片可以进行堆叠呢？这里面我们讲的主要是未经过封装的裸芯片。曾经有用户问我，封装好的芯片可不可以进行堆叠呢？一般来说是不可以的，因为封装好的芯片引脚在下表面直接焊接到基板上，而裸芯片的引脚一般在芯片上表面，通过键合的方式连接到基板。正是由于裸芯片引脚在上方，和基板的连接方式比较灵活，才有了芯片堆叠的可行性，参看下图
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/ K5 @% f, o4 n/ ]/ }; M) Y 金字塔型堆叠2 N8 ^0 w C/ N& Z) P. d F8 a y/ N
金字塔型堆叠是指裸芯片按照至下向上从大到小的方式进行堆叠，形状像金字塔一样，故名金字塔型堆叠，这种堆叠对层数没有明确的限制，需要注意的是堆叠的高度会受封装体的厚度限制，以及要考虑到堆叠中芯片的散热问题。金字塔型堆叠参看下图。% E. {$ p( O0 y4 G# H4 _/ I
, M% C0 l* G: x. D7 y 悬臂型堆叠
! v0 h2 ?( I* c( W: O2 D0 c 悬臂型堆叠是指裸芯片大小相等，甚至上面的芯片更大的堆叠方式，通常需要在芯片之间插入介质，用于垫高上层芯片，便于下层的键合线出线。这种堆叠对层数也没有明确的限制，同样需要注意的是堆叠的高度会受封装体的厚度限制，以及要考虑到堆叠中芯片的散热问题。悬臂型堆叠参看下图。3 ]6 N+ D0 \6 Z g5 t# A
7 ~! w, ?( n" q6 ^1 ?8 G 并排型堆叠! k- U9 \: |. e! p& T
并排堆叠是指在一颗大的裸芯片上方堆叠多个小的裸芯片，因为上方小的裸芯片内侧无法直接键合到SiP封装基板，所以通常在大的裸芯片上方插入一块硅转接板，小的裸芯片并排堆叠在硅转接板上，通过键合线连接到硅转接板，硅转接板上会进行布线，打孔，将信号连接到硅转接板边沿，然后再通过键合线连接到SiP封装基板。并排型堆叠参看下图。, r: u: l: \; ]8 x
6 u6 ~: B5 _' @: ~5 B9 {: _' H6 Y 硅通孔TSV型堆叠$ w4 G# A0 B& }4 J
硅通孔TSV型堆叠一般是指将相同的芯片通过硅通孔TSV进行电气连接，这种技术对工艺要求较高，需要对芯片内部的电路和结构有充分的了解，因为毕竟要在芯片上打孔，一不小心就会损坏内部电路。这种堆叠方式在存储领域应用比较广泛，通过同类存储芯片的堆叠提高存储容量。目前也有将不同类芯片通过TSV连接，这类芯片需要专门设计才可以进行堆叠。TSV型堆叠参看下图。9 Q9 p* [ m5 V% Q
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以上介绍的是SiP设计中四种最基本的芯片堆叠方式。
6 s4 Z$ S3 K$ ^" O: w9 B( I 在实际应用的时候，这几种堆叠方式可以组合起来形成更为复杂的堆叠。另外，还有通过将键合芯片和倒装焊芯片进行堆叠，通过柔性电路折叠的方式对芯片进行堆叠，以及通过POP形式的堆叠等几种，这些芯片堆叠方式在SiP设计中也比较常见。* N! Q6 b" X2 G8 D8 _% m- {
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发表于 2021-11-16 14:09
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