FPGA 中可以取整吗？？如何进行？先谢谢了哦

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FPGA 中可以取整吗？？如何进行？先谢谢了哦
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理论的

fpga中你可以通过移位<<、>> 操作实现对浮点数的处理
! K: Y8 h. j: s$ B: U比如2.3可以这样表示：
2+(1>>2)+((1>>4)/5)*4
其中1>>2表示1/4=0.25;
) ~% x8 H% M& @& A% H7 Y(1>>4)=1/16=0.0625;
0.0625/5*4=0.05;
那么，按你的意思四舍五入，只需将输入的数据左移一位（*2），判断生成的新数据的最低位是否为1，是1则取（原始数据+1）；是0则取（原始数据）即可

rergr

看一下别人是怎么说的
+ W% F$ A3 T0 K) g' i+ N

QQ2224043166

IEEE754标准中,舍入处理提供了四种可选方法：
就近舍入 其实质就是通常所说的"四舍五入"。例如,尾数超出规定的23位的多余位数字
' ?0 }/ {6 r  z* `9 W9 x是10010,多余位的值超过规定的最低有效位值的一半,故最低有效位应增1。若多余的5位
4 D/ W. V, @) l, f" k. P7 w% k是01111,则简单的截尾即可。对多余的5位10000这种特殊情况：若最低有效位现为0,则截
8 P8 i& f1 @9 u4 [, s5 s尾；若最低有效位现为1,则向上进一位使其变为 0。
朝0舍入 即朝数轴原点方向舍入,就是简单的截尾。无论尾数是正数还是负数,截尾都使取
2 z8 I! G9 y2 T& w值的绝对值比原值的绝对值小。这种方法容易导致误差积累。
! K6 ~: h+ D4 a$ G5 n朝＋∞舍入 对正数来说,只要多余位不全为0则向最低有效位进1;对负数来说则是简单的
截尾。
朝－∞舍入 处理方法正好与 朝＋∞舍入情况相反。对正数来说,只要多余位不全为0则
9 Z1 ~' x6 }/ l简单截尾;对负数来说,向最低有效位进1。