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DSP的单元寄存器

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发表于 2021-9-22 09:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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ADC单元寄存器分为如下:8 m8 @: Q9 i8 `2 B$ _
ADC控制寄存器1ADCTRL1;
; z1 Y5 A$ Y9 _. D$ e* K1 X3 KADC控制寄存器2ADCTRL2;
2 r6 C5 w- j( {  }2 x4 R, tADC控制寄存器3ADCTRL3;
; |6 ^- T) L9 \- k3 G* ~) N, [! ]最大通道数ADCMAXCONV;' b# _: S  _! R9 L# |+ m0 A* I
ADC输入通道选择排序控制寄存器ADCCHSELSEQ1、ADCCHSELSEQ2、ADCCHSELSEQ3、ADCCHSELSEQ4;
( T: Z7 ^& y2 k0 lADC自动排序状态寄存器ADCASEQSR;7 J4 `* t( B, }" K+ q
ADC结果寄存器ADCRESULT0~ADCRESULT15。2 p$ ^, f) {' V
一、ADCCTRL1
# Y$ c( w8 {: eSEQ_CASC:排序器模式;=0为双排序器方式,=1为级联排序器方式。
5 @0 g7 \/ [2 N7 J' ], `CONT_RUN:运行方式;=0为启动/停止模式,=1为连续运行模式。  r9 J' J- t% H+ u
SEQ_OVER:排序器运行方式(连续运行);=0完成MAXCONV1个通道转换后,排序器指针复位到初始状态,=1结果寄存器ADCRESULT15更新完成后,排序器指针复位到初始状态。
  ~. R) z( u5 h9 dCPS: 转换时间预定标器,对外设时钟HSPCLK分频。=0不分频,=1为2分频。6 U5 f% m7 ^' }$ W3 |
ACQ_PS:采样时间选择位,延长SOC脉冲宽度,增加采样时间,SOC脉冲宽度为ACQ_PS+1个ADCCLK周期数7 {5 s) k/ P' S4 d
RESET:ADC软件复位;=0无效,=1复位整个ADC模块
/ a$ q. a& x' B0 D  o二、ADCTRL2
, o9 I# n2 v8 l3 Y4 _+ m5 d, d* M" VRST_SEQ1:复位SEQ1;=0时无效,=1时复位排序器SEQ1为CONV00;
7 y9 U3 O$ t' X# r: o( Q4 BRST_SEQ2:复位SEQ2;=0时无效,=1时复位SEQ2为预触发状态,即CONV08;
1 M% \6 }8 l! i! T2 T- _4 x/ o) dEPWM_SOCA_SEQ1:SEQ1的EPWM的SOCA屏蔽位;=1时,允许 EPWM SOCA触发信号启动SEQ1;
$ F, t" H/ U8 t7 D! [% J% FEPWM_SOCB_SEQ2:SEQ2的EPWM的SOCB屏蔽位;=1时,允许EPWM SOCB触发信号启动SEQ2;' t5 _5 w7 ?$ t/ l/ }# ^
INT_ENA_SEQ1:SEQ1中断使能,=1时允许SEQ1向CPU发出中断申请;  V1 X- s8 ]. @  k2 A' R
INT_ENA_SEQ2:SEQ2中断使能,=1时允许SEQ2向CPU发出中断申请。
  A4 P2 C. C- Q3 J$ DEXT_SOC_SEQ1:SEQ1的外部信号启动位;=1时允许外部引脚ADCSOC启动SEQ1;) r, e7 d- V! }1 |
EPWM_SOCB_SEQ:允许EPWM SOCB触发信号启动SEQ# A8 N( q1 X$ g! l
三、ADCTRL3* n+ }5 _" Q  a! |( i  P
SMODE_SEL:采样模式选择;=0时顺序采样,=1时同步采样。
* {8 |3 T! Z, Z3 V4 PADCCLKPS:ADC内核时钟分频器,将F28x的高速外设时钟HSPCLK进行2ADCCLKPS的分频,分频后的时钟FCLK再经过CPS位的不分频或二分频得到ADC的内核时钟ADCCLK.
% W$ f4 ^+ j1 ~) CFCLK=HSPCLK/2ADCCLKPS;
2 I& _# z# X& l) xADCCLK=FCLK/CPS+1;' m0 f' E# K, F: F% v5 b& E
四、ADCMAXCONV+ p0 R4 l- p4 R! N; G
自动转换过程中最多转换的通道数:5 A& K( g6 k3 Y  [; O4 x2 u
对于SEQ1,使用MAX_CONV1
. G* i. ^% j& U+ e  \& n9 `对于SEQ2,使用MAX_CONV28 p/ r2 o2 o. T9 O& N; R
对于级联排序器SEQ,使用MAX_CONV1;
) w0 P0 ?  L3 G( F0 b( s8 `每次转换都是从初状态开始转换,依次连续的转换直至结束,并将转换的结果按顺序装到结果寄存器中,每个转换序列可以转换的通道数位1~MAX_CONVn+1./ }% W: N/ \( v7 H0 p3 k6 H- Y6 M
五、ADCAEQSR
0 q+ H% j, [' a0 H# o( k5 MSEQ_CNTR: 排序器计数器状态位,显示SEQ1、SEQ2和级联排序器SEQ中正在转换的通道数。转换开始时,自动装在MAX_CONVn的值,每次自动序列转换完成后,SEQ_CNTR的值减1
9 w& s$ x; |& u7 e+ j7 K六、ADCCHSELSEQn
% P( l; }( ]5 g8 k. hADCCHSELSEQ1、ADCCHSELSEQ2、ADCCHSELSEQ3和ADCCHSELSEQ4。ADC模块有4个排序控制寄存器,每个排序控制寄存器有16位,ADCCHSELSEQ1的低四位为CONV00,依次为CONV01、CONV02和CONV03,ADCCHSELSEQ2的16位分为CONV04\CONV05\CONV06\CONV07,ADCCHSELSEQ3的16位分为CONV08\CONV09\CONV10\CONV11,ADCCHSELLSEQ4的16位分为CONV12\CONV13\CONV14\CONV15,
0 X# z% \$ C9 L3 K5 E% i每4位CONVxx可以为一次自动排序转换选定一个输入通道,其中最高位决定采用哪个采样保持缓冲器,低三位决定具体的输入信号。在同步采样中,CONVxx的最高位不起作用,S/H-A和S/H-B同时采样低三位确定的输入信号。
  p  P- |( l7 l+ O4 q七、 ADCRESULTn9 I3 M2 j8 k  S+ d( F" n0 q
ADC采样模块为12位,结果寄存器为16位,必有4位是保留位。, P+ V5 S! M% L$ o- u
若结果寄存器映射在外设帧2中,则有2个等待状态,并采用左对齐;3 p# B0 i6 q, w2 K
映射在外设帧0中,不需等待,采用的是右对齐* f$ q& Z8 ?- n1 @$ B! ?

) p; r1 ]1 F6 y2 I$ t1 }
* n$ K! B  G/ K& f- m
1 u( s6 y% W' L. _( W& W

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2#
发表于 2021-9-22 10:46 | 只看该作者
在同步采样中,CONVxx的最高位不起作用,S/H-A和S/H-B同时采样低三位确定的输入信号

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3#
发表于 2021-9-22 15:35 | 只看该作者
每次转换都是从初状态开始转换,依次连续的转换直至结束的

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4#
发表于 2021-9-22 16:04 | 只看该作者
ADCMAXCONV是自动转换过程中最多转换的通道数
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