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怎么检查layout过后元件及其管脚的正确性?

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1#
发表于 2021-9-18 09:41 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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怎么检查layout过后元件及其管脚的正确性?2 z1 [4 y# Z  a" _2 A* T( W

该用户从未签到

2#
发表于 2021-9-18 10:57 | 只看该作者
管脚的对应是否全部正确,只能拿封装,原理图进行对比哦
' _# ~' X- h  f' L2 ], \+ g6 p  |3 q

该用户从未签到

3#
发表于 2021-9-18 10:59 | 只看该作者
重要检查主要芯片,然后就是极性元件。。。。! Y: [1 m* X: P4 y! n3 c& T. |
  • TA的每日心情
    开心
    2022-3-3 15:43
  • 签到天数: 24 天

    [LV.4]偶尔看看III

    4#
    发表于 2021-9-22 17:10 | 只看该作者
    首先要保证原理图上的元器件管脚是正确的,然后layout时用“对比/ECO工具”来与原理图比对,工具-对比/ECO工具,选择PCB文件与原理图文件(原理图需转成ASC格式),再勾选“生成差异报告”即可看出与原理图之间是否有差异。
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