找回密码
 注册
关于网站域名变更的通知
查看: 1060|回复: 4
打印 上一主题 下一主题

FPGA的硬件架构

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2021-8-27 09:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
Xilinx FPGA是异构计算平台(所谓异构,就是有很多不同的部分组成),包括Block RAM、DSP Slices、PCI Express支持和可编程结构。由于所有这些计算资源都可以同时使用,因此它们可以在整个平台上实现应用的并行化和流水线化。
, Q3 G+ {# x6 i8 y
! G$ o2 u8 W. u$ G, gFPGA的基本结构由以下元素组成。+ C: Z, w. L, a2 |9 i

$ c+ g9 U% L' V7 Y查找表(LUT)--该元件执行逻辑运算。, Y5 @4 X0 [6 [" f
触发器(FF)--这个寄存器元素存储LUT的结果。
& S  N; `" {) Q( F) D' u. T布线资源--将各种元件彼此连接。: e) ^! K3 s+ f$ k; e
输入/输出(I/O)引脚 - 这些物理端口将数据输入和输出FPGA。
: w+ I+ q/ @8 M  e' ?) j" M6 [; M% J- Z$ ]/ V! ]) T8 j( K' \6 f
这些元素的组合形成了下图所示的基本FPGA结构。虽然这种结构足以实现任何算法,但从计算吞吐量、所需资源和可实现的时钟频率来看,所产生的实现效率是有限的。
0 J4 T) x& e" x# f2 Z& E3 o" ?: q" @: q; p8 k
当代FPGA架构将基本元素与附加的计算和数据存储块结合在一起,提高了器件的计算密度和效率。这些附加的元素包括:" ~. H$ y7 i- ~( C

/ V! R; S9 T: G: R" `3 j用于分布式数据存储的嵌入式存储器(Distributed RAM)0 Z, u+ z0 m7 k/ n
锁相环(PLL),用于以不同的时钟速率驱动FPGA结构。(PLL/MMCM)+ G% T0 \( H/ C) c
高速串行收发器(Transceiver)
2 F8 ]; t' ~" J' O2 M) s片外存储器控制器(MIG), ^- j; C$ C& m
乘累加模块

7 p1 }8 F6 g! g& W# ?0 K

该用户从未签到

2#
发表于 2021-8-27 10:46 | 只看该作者
当代FPGA架构将基本元素与附加的计算和数据存储块结合在一起,提高了器件的计算密度和效率
0 o- x- C. W3 y

该用户从未签到

3#
发表于 2021-8-27 11:02 | 只看该作者
用于分布式数据存储的嵌入式存储器2 g" h5 f) y5 C( ~$ }' Q

该用户从未签到

4#
发表于 2021-8-27 11:15 | 只看该作者
虽然这种结构足以实现任何算法,但从计算吞吐量、所需资源和可实现的时钟频率来看,所产生的实现效率是有限的
; }  }/ k& u/ ^0 i1 ~. F

该用户从未签到

5#
发表于 2021-8-27 13:21 | 只看该作者
来学习了   
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-8-12 11:52 , Processed in 0.109375 second(s), 23 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表