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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑
# t* L) }% `/ J8 F
$ r1 o8 a- g$ x! v) O* p9 y9 H9 A      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。
, O0 \7 Z  G* p1 ]+ K) o8 a" P0 A0 p
       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.0 A) p  ^# n: Z" P& Z

( F7 j' D2 l! L  z0 s" W      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。- j2 k! C$ a  H% C( }* x" \7 x

: q0 f/ ^  R* Z: v2 x+ D     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。 3 t! o4 i7 ^5 f7 |! S" y) Z; D
6 m* p+ `, F* j  H
想问一下的就是,
6 \% ~- H+ M5 w9 s1.40mA的驱动电流计算是否正确?
* F" I+ y( W1 G2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?, h( p) S7 a$ U' E: E5 M
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?1 W7 K( L3 z9 }( M# D

: [* c2 O# z, m
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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子
    0 u9 I) v) H) o# ^, n# o9 I6 B' B/ D2 q0 {8 h0 X" \7 U
    明白,但是对面的设备信息如下:
    + L! u1 x( w  p
    * J2 [. G. p- \1 v0 q+ n# L- l: [; t
    input impedance : 50 ohm/ Z% N* `8 ~. f( d
    input level :HCT% }( }) ~% w; w% S+ k6 A

    # X4 N0 \' c) R7 L  n; M1 K所以没办法。
    & N0 m) S4 e& d# k3 z* h9 [. n
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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