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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑   p* \4 |0 w$ N4 r$ k

* \6 v* s" z, F      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。: P0 M* q3 Q; x" a" T. M% T/ u

9 G& a8 d( p- K" C3 C       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.
  l% @4 h. H0 C) a( _
. y' n+ b6 D7 [& {7 A      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。
0 }+ T  F( Y% S) C9 [! i% X. t
8 L& d0 ]4 r9 P( ?- |     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。 % |2 P# v% }& d) s: a
+ ^' ?9 x1 A& z- f8 O: l
想问一下的就是,# F& J" c6 t9 i' p) p
1.40mA的驱动电流计算是否正确?
  P6 C9 m& B% ^2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?
. j! V4 h' [) V4 v1 }. e3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?
- @9 S! Q/ K( e5 m. d
& e* f% B& B  f
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    [LV.3]偶尔看看II

    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子7 [( d. K, \1 _, T+ D
    ) |6 B& _( j3 ~$ H, ]7 l9 n& q9 O
    明白,但是对面的设备信息如下:8 K" ^; s/ b/ e( y% W0 r5 ~6 A7 h

    ) ^7 C1 B- E) w, G& P* E2 d# h
    8 ^! _  i5 B9 Y1 a+ Ainput impedance : 50 ohm  [  d; Q6 M1 \
    input level :HCT/ m% _: l( @' _' s6 t2 n2 c+ H) I% a2 E
    / R+ J2 b3 i9 S; R- L
    所以没办法。
    ' M  _& C* W( @( y3 t0 a- \% [
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    [LV.3]偶尔看看II

    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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