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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑 * |8 N$ Q. S1 n1 K* |$ c4 g) ~. D" b& s
0 j! _' J; l7 A; o% y6 B
      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。
) c6 x  o8 l$ e  ?% h& v
( w$ |$ X. d9 b5 I       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.
  t. W. V2 l3 D1 L# u) ?* o# v) @2 X* w' m- b6 t+ s% R8 l, G+ ^2 r, _. ^
      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。5 ]" J$ @" ^8 Z: V7 |8 Q( t. H& k

  c4 h: T8 y( r0 h     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。 2 o  s( Q/ W6 A

! ~+ B$ i' `5 X; s; q. _8 O0 p; X6 l想问一下的就是,
  Z; D; t2 i8 r! l4 f& d+ m1.40mA的驱动电流计算是否正确?
5 _) M8 M0 }, @9 j  O9 K2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?$ @8 c5 K) V% I
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?; D- j" S/ G9 e6 b- q

$ ^! v8 x% F& d5 X
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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子- k' }. K9 ]6 _2 L

    " \& h3 _2 k/ u" X" S明白,但是对面的设备信息如下:
    1 t* c$ X( d7 w4 r& g  k; {% O- D: c: L- ]7 e
    ( t: v" R! v$ k0 R$ n! o: q) l
    input impedance : 50 ohm( M1 B% }# `, j+ k  _, [* @- j5 N
    input level :HCT' O% x2 |( ~7 @9 e3 _

    ( P1 M& T& ?! d1 j/ ^所以没办法。7 O0 B2 F  b' h1 X5 h" S/ {
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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