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[仿真讨论] Mismatched Load Termination_有图无真相

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1#
发表于 2011-5-16 11:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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5 d9 V1 K. w; M( e# R0 B4 q; A

1 i$ E* _+ g* A. q# |1 f诸位看下这张图错在哪?
3 b6 z4 N, V$ G, o- m

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2#
发表于 2011-5-16 12:26 | 只看该作者
上 Zi < Z0 及 下 Zi > Z0 ( 应该对调)。

评分

参与人数 1贡献 +10 收起 理由
forevercgh + 10 正解

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3#
发表于 2011-5-16 13:39 | 只看该作者
看不懂,望解答,先谢过。

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4#
 楼主| 发表于 2011-5-16 14:50 | 只看该作者
TDR的原理就是这样了,只不过图中标注有错。
4 H. s" e4 ?6 |" ^$ ^; q/ \3 ~8 j如 honejing 的更正说明。

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5#
发表于 2012-11-15 13:23 | 只看该作者
我想请问你,hyperlynx仿真以后的数据可以反向导入到design capture或者Expedition pcb吗?
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