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FPGA例化

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lucien

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发表于 2021-5-20 14:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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FPGA例化似乎信号名不能与例化名相同
; Y' [3 @* D! q! u如图，相同的时候5 o  I& f- J% v4 C" n" g3 ]9 r; ~
* `' B  h( e: U* T) Z4 ^" d/ m8 j7 x
如图，不同的时候
( l+ p7 C( V5 m0 X, ?/ J
! {6 {& |1 b, G9 W 4 p4 V% F* _% \- R  h) I

8 u. p/ n/ H$ k6 ~7 L% i所以，建议例化名为“模块名_U1/U2”的形式# S4 v4 F3 j( H  i/ x2 M

. Y8 {% m8 k4 G' e, c' ?0 v# e9 V2 p6 a

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sdkangbaz

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2#
发表于 2021-5-20 18:12 | 只看该作者
欧克欧克                           

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