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allegro中制作封装时,可以设置Line画在 Etch top吗

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发表于 2021-1-19 21:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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allegro中制作封装时,可以设置Line画在 Etch top吗?这是不是相当于死铜了

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1611060979.jpg (18.59 KB, 下载次数: 5)

1611060979.jpg
  • TA的每日心情
    开心
    2021-1-19 15:14
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    [LV.1]初来乍到

    2#
    发表于 2021-1-20 09:20 | 只看该作者
    本帖最后由 CHJLQQ 于 2021-1-20 09:22 编辑 + ?; x4 }* C$ p: d; T& q
    ( ~/ Z! J' h2 k- t8 B
    你这样做的目的是什么?看有没有其他的解决方法!没什么好处为什么要在ETCH层做?# L8 Q" x1 m6 J3 U
    用来做对位的金线?6 I1 `8 d9 @9 j- M

    点评

    因为现在用的是别人提供的封装,Line 画在 Etch top层 做出来的效果是有铜皮的吗?  详情 回复 发表于 2021-1-20 09:29

    该用户从未签到

    3#
     楼主| 发表于 2021-1-20 09:29 | 只看该作者
    CHJLQQ 发表于 2021-1-20 09:20
    - {5 ^# n$ l+ V  l7 ~0 N. F你这样做的目的是什么?看有没有其他的解决方法!没什么好处为什么要在ETCH层做?- j  c5 U/ A( `' i9 y
    用来做对位的金线?

    # Z+ g- i" f/ Y8 R% Y& B; n" J$ p因为现在用的是别人提供的封装,Line 画在 Etch top层 做出来的效果是有铜皮的吗?9 Q$ ^& ~& A  B" I- D, s2 k- F3 ^

    点评

    是滴哟!!  详情 回复 发表于 2021-1-20 09:37
  • TA的每日心情
    开心
    2021-1-19 15:14
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    [LV.1]初来乍到

    4#
    发表于 2021-1-20 09:37 | 只看该作者
    本帖最后由 CHJLQQ 于 2021-1-20 09:39 编辑
    4 I# C1 F& f/ _
    wangbao97 发表于 2021-1-20 09:295 I6 v0 S4 g' p
    因为现在用的是别人提供的封装,Line 画在 Etch top层 做出来的效果是有铜皮的吗?

    : [* E4 Z3 c1 M% Z" @" R+ z- q是滴哟!!
    8 e/ K; k% r: |. W3 K7 K; I 9 f4 G7 ^' u6 p9 i+ X! I# L. p
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    2020-12-1 15:20
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    [LV.5]常住居民I

    5#
    发表于 2021-1-20 09:41 | 只看该作者
    一般封裝的line不會在etch層處理,畫在etch等同於no net的電性線而己,如果你要走線或打via,碰到還會有error
    5 N3 u  }- E# D9 w6 ]沒理由會在etch才是,
    % w- m2 V/ P. Y, h( |* J如果你是想做sensor的光學對角點,建議做二個封裝放置
    ) m( j+ O5 H8 i, q0 y7 c1 c' i1 [5 `/ ^( T, E) U

    该用户从未签到

    6#
    发表于 2021-2-17 22:13 | 只看该作者
    这个就是对位用的金线,但同时要在SOLERMASK画LINE,不然无法亮铜
  • TA的每日心情
    无聊
    2021-6-19 15:40
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    8#
    发表于 2021-6-4 16:35 | 只看该作者
    可以呀,看具体需求吧,定位标识Logo啥的,露金线显得高大上

    该用户从未签到

    9#
    发表于 2021-6-20 18:57 | 只看该作者
    如何匹配3D模型

    “来自电巢APP”

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    10#
    发表于 2021-9-18 20:56 | 只看该作者
    这个用来辅助对位用的,一般BGA封装才有这个,毕竟丝印框会有骗位的情况,这个就毕竟准确了
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