DDR4 CK的S参数提取报错

硬件小A · 发表于 2020-11-22 12:10

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如图所示，在提取S参数时报错，是否是设置问题？（1）DDR4差分时钟的端接TOPO如下

（2）选择仿真的网络和器件如下，没有对应CK相关的上拉电阻器件

（3）选择component时设置了对应的端接电阻R1 1 2 39

硬件小A · 发表于 2020-11-24 17:12

keepwalking 发表于 2020-11-24 16:19
" L1 m5 r1 S4 @找到办法了，选择网络的时候，把电阻和电容那个网络也选中，就不报这个错了

那个网络我选了，还是会报错

liou366692 · 发表于 2020-11-22 16:47

:victory::victory::victory::victory::victory:

Bill168 · 发表于 2020-11-23 08:09

:):):)

dzkcool · 发表于 2020-11-23 09:36

只看到了报错信息，1、2、3点提到的截图都没看到。
如果有端接电容，要把电容的模型也设上

lhliu6 · 发表于 2020-11-23 10:12

谢谢楼主分享

liou366692 · 发表于 2020-11-23 15:39

谢谢楼主分享

硬件小A · 发表于 2020-11-24 09:47

补充图，已上传

keepwalking · 发表于 2020-11-24 10:24

我也碰到同样的问题了，CLOCK上的端接报没有GND端口。但是地址线上的端接倒是没有报错

keepwalking · 发表于 2020-11-24 16:19

硬件小A 发表于 2020-11-24 09:47* P7 a( A# |, T- y* s+ ^, r
补充图，已上传

找到办法了，选择网络的时候，把电阻和电容那个网络也选中，就不报这个错了

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[Cadence Sigrity] DDR4 CK的S参数提取报错