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[仿真讨论] 有关叠层问题请教大神。

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1#
发表于 2020-11-11 16:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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四层板(机顶盒)叠层情况如下:
2 C) M6 Y# u9 |9 Btop          signal  (主芯片、大部分元件)
. b9 b& L( }; b% _8 i) h! cin2           GND: z7 B8 Q5 G6 X( K4 D4 k
in3           POWER
8 m  Y: p% I* G5 `* X- L5 q/ Fbottom    signal    (小部分元件)
- \5 Y% V! q* \+ ]# Y7 Z3 u这里第二层完整的地保证了顶层信号线的阻抗连续,确保了信号的完整性;2 Y% }% l, j- D6 W+ \
但是第三层的POWER有没有什么影响?请教大神,非常感谢!" k6 C8 _+ P0 H  I
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    [LV.8]以坛为家I

    推荐
    发表于 2020-11-11 17:36 | 只看该作者
    注意底层高速、时钟等信号不要跨第三层分割。

    该用户从未签到

    2#
    发表于 2020-11-11 16:32 | 只看该作者
    如果你的信号速率不是特别高,没有太大影响。

    该用户从未签到

    3#
    发表于 2020-11-11 16:33 | 只看该作者
    且一般四层板的叠层都是这么弄的。
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