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电路设计时怎样减少静电放电对线路的损坏

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发表于 2020-10-28 10:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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电路设计时怎样减少静电放电对线路的损坏
* h7 u; J. `3 L) K+ T& H3 b, u4 b9 d2 B1 e! ~  N6 f$ ^* j  M5 ?# k
1)尽量使用屏蔽电缆  d0 n- C* V/ ^" c1 y& i! A  y
2)在接口处安装滤波器
: X8 L, z& @  x3)将无法安装滤波器的敏感接口加以隔离
4 `: U' G6 K: f0 c+ E6 P. V4)给有关电路设置接地保护
9 i6 G  E% ?* N% G- P# q5)选择低脉冲的频率的逻辑电路, j# o3 E2 }8 i
6)保持地电流远离敏感的电路及有关线路。
: F& q4 N5 F( e  S$ z

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2#
发表于 2020-10-28 10:57 | 只看该作者
楼主说的这几点确实很关键。
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