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XRAM是一种新的内存架构，旨在以具有竞争力的价格提供高密度和高性能RAM.XRAM使用先进的DRAM技术和自刷新架构来显着提高内存密度，性能并简化用户界面。
( s# n5 I3 }2 p% ]# w
+ [6 t* Y0 F8 u u& _8 k/ q9 o/ ZXM8A51216V33A在功能上等效于异步SRAM，是一种高性能8Mbit CMOS存储器，组织为512K字乘16位和1024K字乘8位，支持异步SRAM存储器接口。星忆存储代理英尚微电子支持提供例程及产品应用解决方案等产品服务。- {; L3 c4 g' s4 D8 W
6 j( O% Q- C H1 T8 s0 }# t7 ~/ l特征
7 W- L( W! S4 Y/ P( a/ Z3 ^•异步XRAM内存, p \) M, M3 ^+ R
•高速访问时间
1 \. I F" R$ }8 L9 y2 H1 Z9 `•tAA=10/12纳秒
( @, a6 Y }3 \1 E& G•低有功功率) O7 I" g9 ]: S: J
•ICC=80 mA时为55 mA) v6 d& d3 m0 ^. }0 A y0 P
•低CMOS待机电流1 J. v0 Y2 F' a2 i. H
•ISB2=20 mA（典型值）
. F1 _' s B2 K4 Z2 ]•工作电压范围：2.2 V至3.6 V# d3 E2 y4 q- k7 j3 X/ z3 V
•取消选择时自动掉电
+ u! {+ l T2 O, l* l$ k" t! z•TTL兼容的输入和输出. e2 a+ Y1 m% z2 [: e
•提供44引脚TSOP II，48引脚TSOP I封装和48焊球FBGA封装$ n# N# U( k5 a
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5 I6 G+ p0 [$ l& d! d# N8 H- j0 X 44引脚TSOP II引脚排列 48引脚TSOP I引脚排列
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9 m$ V& O- j" u1 d, \) O 要写入设备，请将芯片使能（CE）和写使能（WE）输入设为低电平。如果字节低使能（BLE）为低，则来自I / O引脚（DQ0至DQ7）的数据被写入地址引脚（A0至A18）上指定的位置。如果字节高使能（BHE）为低电平，则来自I / O引脚（DQ8至DQ15）的数据将写入地址引脚（A0至A18）上指定的位置。要从器件读取，请将芯片使能（CE）和输出使能（OE）设为低电平，同时将写入使能（WE）设为高电平。如果字节低使能（BLE）为低，则地址引脚指定的存储器位置中的数据将出现在DQ0至DQ7上。如果字节高使能（BHE）为低，则来自存储器的数据出现在DQ8到DQ15上。# Y: d/ w/ N- C% A! {' @9 C
, ~0 p) B& l) v4 g6 ?8 Y
取消选择器件（CE），禁用输出（OE HIGH），禁用BHE和BLE（BHE，BLE HIGH）或以下操作时，输入或输出引脚（DQ0至DQ15）处于高阻抗状态写操作（CE和WE LOW）。突发模式引脚（MODE）定义突发序列的顺序。当置为高电平时，将选择交错的突发序列。当拉低时，选择线性突发序列。
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XM8A51216V33(8M).pdf
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发表于 2020-9-7 15:14
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发表于 2020-9-7 17:13