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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › PADS PCB论坛 › plane层铺铜连接性错误怎么解决
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plane层铺铜连接性错误怎么解决

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yishu1985

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1#
发表于 2010-11-3 10:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 yishu1985 于 2010-11-3 10:15 编辑 # t. m1 K* b0 N  c  O: W

: l# K8 i/ x4 ]: Y 2 H% i# W' F/ U0 H3 u
! n0 c  x- Y7 d/ w- s4 Z8 {
6层板，图是第四层的GND铺铜，Plane层，像这样的错误有11个，我能确保GND层在其他层已经连接好了
# q, D% j% C  G* E! e" K) n1 O2 m
现在检查Plane错误的时候出现这个错误，有什么对策吗？0 `, ]7 q7 d  ~2 ^) Q

  V8 g9 y; i6 _! D7 l# \- ?GND已经在第二层和第五层已经连接上了
, E, W# Z; b( ~
% D# |) R4 @# P$ _请明白人指点
5 O+ t3 G( i( y5 Z
4 k' p6 q7 l# P

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zhangtao2

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2#
发表于 2010-11-5 11:42 | 只看该作者
是铺铜那里出现死铜了吧，报错的话地会报出很多错误但不一定每个都是真正的错误，你仔细检查看看！

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yishu1985

该用户从未签到
3#
 楼主| 发表于 2010-11-5 14:41 | 只看该作者
回复 zhangtao2 的帖子$ v5 P9 A& H( _, r4 n( r/ E# F& y
1 ~9 R" i- M  b3 d3 p
我知道是死铜，这个在POWER层好像还真没办法解决9 p+ q/ w0 g. I7 ^2 _
表层的有设置
/ l4 x# O4 y) t. @

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zhangtao2

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4#
发表于 2010-11-5 16:58 | 只看该作者
拉条地线连接不行吗..............

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