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菊花链封装(daisy chain package)

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1#
发表于 2020-8-22 00:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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问下大神们,  问下验证芯片封装基板可靠性的菊花链设计有没有什么资料可以参考?  
; j" D) e. [1 b
+ f* o4 t) m8 ~3 U8 Z# k
3 h2 |& G$ a7 d: q& Z/ f
只在百度搜到一条说明:  把所有管脚相间连接,再装到PCB电路板上,使所有管脚连成一线,线的两端做输入和输出。
9 U& o0 t# N; o0 ~( Q% ?! D& Y! h
相间连接 是什么意思?
输入和输出之间测什么数据? 是测量线路的电阻在可靠性前 和 可靠性后的变化率么?
8 {4 Q9 o, q  Z

点评

谢谢分享!: 5.0
一時沒想起全名 - JTAG Boundary Scan ^_^  发表于 2025-8-6 20:50
谢谢分享!: 5
可以查一下 JTAG Daisy Chain!  发表于 2025-8-6 17:52

评分

参与人数 1威望 +5 收起 理由
超級狗 + 5 菊花開爆獎勵!

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该用户从未签到

2#
发表于 2020-8-24 10:07 | 只看该作者
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