PCI总线时序仿真

wkb1987 · 发表于 2010-10-13 18:53

EDA365欢迎您登录！

您需要登录才可以下载或查看，没有帐号？注册

x

如下图1所示,PCI总线的时钟由主设备内部提供，当PCI设备发动数据传输时，此时的时钟肯定不是源同步，好像也不能说是共同时钟。这种情况下，如何进行时序仿真？
恳请大家指点下，谢谢！

wkb1987 · 发表于 2010-10-14 11:05

PCI主设备上没有其它的时钟了，是不是有可能PCI主设备芯片内部有一个回环时钟送给自已,进行读操作？

wakinoda · 发表于 2010-10-18 08:41

本帖最后由 wakinoda 于 2010-10-18 08:41 编辑

异步时钟考虑，用master端的clock采样slave发过来的数据。
譬如CLK1从Master发出，通过Flight_clock时间到达Slave，然后经过Slave的Tco时间由Slave发出Data，再经过Flight_data时间到达Master。我们就用此时刻master的CLK1沿来采样这个到达的data沿，通常这时需要加上一个时钟周期。