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在uart中怎么用verilog实现输出A转换到a

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发表于 2020-6-30 18:12 | 只看该作者回帖奖励

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在uart中怎么用verilog实现输出A转换到a

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发表于 2020-6-30 18:13 | 只看该作者

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不错，很好的经验分享，辛苦麻烦了，欠缺这方面的资料，非常感谢详情回复发表于 2020-6-30 18:13

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楼主| 发表于 2020-6-30 18:13 | 只看该作者

outline9 发表于 2020-6-30 18:13
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不错，很好的经验分享，辛苦麻烦了，欠缺这方面的资料，非常感谢

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