powerDC最后的仿真结果是fail的，为啥，大神解释下

盛伟 · 发表于 2020-6-30 11:15

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小白啊，哪位大神解释一下啊

dzkcool · 发表于 2020-6-30 12:14

本帖最后由 dzkcool 于 2020-6-30 12:16 编辑

很明显，LP500是个红框，说明它有问题。允许的电流为10A+/-3%，实际过流10A，这还是超标了。

杨过j · 发表于 2020-6-30 15:14

用的什么仿真软件

E02577 · 发表于 2020-7-1 09:43

66666666666666666666666666666

盛伟 · 发表于 2020-7-1 10:59

sigrity

盛伟 · 发表于 2020-7-1 14:00

dzkcool 发表于 2020-6-30 12:14
9 ]) ?8 \9 J( D8 R- i; I很明显，LP500是个红框，说明它有问题。允许的电流为10A+/-3%，实际过流10A，这还是超标了。

为啥我铜皮画的这么细，但压降确很小，跟常识不符合。
我是设置的恒流模式，
另外，为啥负载只有电容，互连的mos管没法选择

hyxs714154 · 发表于 2020-7-2 19:30

盛伟发表于 2020-07-01 14:00:38 F4 Z# z8 Z4 j) \) X4 }
[quote]dzkcool 发表于 2020-6-30 12:14: ?+ f$ e" I& o* G) L0 e, P
很明显，LP500是个红框，说明它有问题。允许的电流为10A+/-3%，实际过流10A，这还是超标了。

为啥我铜皮画的这么细，但压降确很小，跟常识不符合。
我是设置的恒流模式，
另外，为啥负载只有电容，互连的mos管没法选择
[/quote]

电流那么小能有多大的压将

kaka2020 · 发表于 2020-7-9 10:22

这个不懂可以来办公室找我啊。。。

xieda2005 · 发表于 2020-8-12 14:11

话说，负载不是选择IC这些么？为什么你的都是电容？

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[Cadence Sigrity] powerDC最后的仿真结果是fail的，为啥，大神解释下

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