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求基于verilog语言的uart程序

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1#
发表于 2020-5-29 19:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我正在开始学习FPGA的知识,现在寻求一个基于verilog的uart程序,要求是初始位一位,终止位一位,数据位8位,实现回环功能。大家能帮助一下我吗?
% j- F% n4 i3 _. S: w4 T" p4 ]

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2#
发表于 2020-5-29 19:50 | 只看该作者
最简单的回环,assign uart_out = uart_in;
) a0 g2 Z! q+ I/ Y, z2 |+ e这样都不用考虑波特率/起始位/停止位/校验位/数据位。7 v" d  k2 F5 p- Q
  M1 |. Y* Y% X3 V- s, b
//------0 N5 \  R7 v6 g/ v+ w# Z3 T: z$ E
可在Tao宝自行搜索FPGA相关的学习开发板,商品页面都有资料下载链接(基本都有UART例程,好像都是带奇偶校验位,需要简单修改)。( J0 Z  L. W) o- m7 d
以下是随机点开两家AX301开发板产品后的资料链接。如果Quartus-ii版本不匹配,自己添加*.v重新构建工程即可。

点评

谢谢  详情 回复 发表于 2020-5-29 19:50

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3#
 楼主| 发表于 2020-5-29 19:50 | 只看该作者
sdsdwwwe22 发表于 2020-5-29 19:50' a) P* F3 N% U
最简单的回环,assign uart_out = uart_in;( [' G7 a0 J- q7 ]" b
这样都不用考虑波特率/起始位/停止位/校验位/数据位。

' e% i, C# u: Y8 U4 {7 _$ ^谢谢
( n% ~) l3 r; t# V0 O
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