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请教:在Cadence 16.3中,如何正确解破解"Design Entry HDL"这个功能模块?

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发表于 2010-5-10 13:13 | 只看该作者 |只看大图回帖奖励

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本帖最后由 chenshiqi906 于 2010-5-10 13:21 编辑

在cadence中,平常我很少用"Design Entry HDL"这个功能模块,今天遇到了一个项目,它的原理图是用HDL编辑的,可当我打开Cadence启用Design Entry HDL这个功能时,却弹出如下提示:

我不知如何解决(我在破解Cadence 16.3时用的是16.2的破解方法,除"Design Entry HDL"外,其他功能模块都能正常使用),请大家帮忙解决一下,在此谢过了.

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