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求助OrCAD Capture CIS 16.3生成网络表的问题

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1#
发表于 2010-3-15 12:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 zjf2010 于 2010-3-18 17:01 编辑
7 ~0 t6 }) L) b8 Q# S$ A  M/ G1 {, J
我是一个新手,怎么就生成不了网络表呢?出现图的情况!麻烦高手帮帮忙!
' v5 Q& M7 j' W8 C8 D
/ M: i7 F# T/ \# d2 b- R1 Y: t9 Q
日志描述:& z- q8 m6 ^# @
Spawning... "F:\cadence\SPB_16.3\tools\capture\pstswp.exe" -pst -d "f:\pbc\mysch\mysch\myproj.dsn" -n "f:\pbc\mysch\mysch\allegro" -c "F:\Cadence\SPB_16.3\tools\capture\allegro.cfg" -v 3  -w -l 31 -s "" -j "PCB Footprint"
( g* x! s) I2 z4 ~7 I0 z- M, H: T#1 Error   [ALG0083] Conflicting values of "PCB Footprint" found on component instance U6D: SCHEMATIC1, DSP_decoupling (71.12, 43.18) ., c0 m  n$ Z/ Z6 E# L+ ^4 q2 x
#2 Aborting Netlisting... Please correct the above errors and retry.

12.jpg (12.11 KB, 下载次数: 7)

为什么出现这个呢?

为什么出现这个呢?

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2#
发表于 2010-3-17 16:10 | 只看该作者
你要看看日志里面怎么描述错误的,贴上来别人才能帮你。

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3#
 楼主| 发表于 2010-3-18 17:00 | 只看该作者
你要看看日志里面怎么描述错误的,贴上来别人才能帮你。
) \; {+ {% [- n. ?# X1 |killerljj 发表于 2010-3-17 16:10
2 A6 J$ k4 c9 y1 i
% T) ^# ?5 ?8 |4 p

9 x4 d1 B1 X' J8 u! I    谢谢

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4#
发表于 2010-3-20 10:56 | 只看该作者
U6D没有指派PCB封装

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5#
 楼主| 发表于 2010-3-20 11:56 | 只看该作者
U6D没有指派PCB封装! p+ i+ t, J) {# f1 [; _
tuzhiquan 发表于 2010-3-20 10:56
6 l) P. H1 o& c" y

7 Q$ g$ \8 B+ x3 f9 y3 g3 t" C% s: B4 E/ p
   非常感谢,我是整体修改封装,把它的封装写成电容了。看来以后还是小心才行啊
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