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FPGA Verilog 串口无限多字节收发+流水灯程序+ModelSim仿真

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发表于 2020-3-4 11:23 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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2 N5 @9 p9 G6 i1 P' x8 N& C2 J* i工作环境# j' k% t; v1 Z! z! w( A5 {
1,软件环境:Windows 7、Quartus II、ModelSim SE、串口调试助手0 s% |' t: t) p: v4 l( J/ F
2,硬件环境:开发板:EP2C5T144C8N核心板、USB Blaster下载器
5 `3 A0 |( f, v3 l7 b
) T" }# O7 @4 [& T2 u发现网上的FPGA学习资料多如牛毛,质量参差不齐,最近正好比较闲,于是花了三天时间,写了一个很好的FPGA例程,集成了串口无限字节收发模块、流水灯模块、ModelSim SE仿真脚本等功能模块,非常适合初学者下载作为第一个HelloWorld程序学习。下面来简单的介绍一下这个项目,在文章的最后我会放出下载链接,希望能够抛砖引玉,帮助更多的FPGA爱好者进去FPGA神奇的天地。
! H) ~" i+ {9 p( }5 Z& D
5 b4 w5 I1 k6 ^1)开发板3 q* ]' g* d/ P6 ?' r( e
* D; E% {, g. @. a

4 I3 {; ]0 r% j- J& L+ h. P, ~* T8 H3 r* J- X: s5 T- r3 u

- \$ W4 P. p6 x( Y% _2)串口收发  G( }) [1 h1 s; w, j- F

' s8 N: m, Q4 f, R: Q% q" d, Q# m①选择串口号,②设置波特率9600,③校验位选择偶校验即可,发送区随便输入任意长度数据,点击发送即可。( S( B% \4 u% h6 p

& `2 Q, Q6 h# c5 c8 H2 P6 f 5 [; `, |: O0 t5 ]' |
! u+ Y4 J( g2 k  [5 n4 |5 r+ p
可以看出,效果相当不错,收到什么发送什么,误码率为0。下图为硬件效果(串口有数据的时候LED闪烁):
4 G% q/ i& ^+ B/ o
# [) c9 h% A" O" I$ ` 8 u& g* f! O5 g; m* f6 E: `
) n% ~7 F2 w8 O2 D3 y
3)流水灯效果
7 R' g! o. i& x' I5 m
. M- d% x6 D, `6 {" d+ B ' w. T) F' |% p, r4 `* O% l
% J2 ?  ~, I7 O. i8 W
4)ModelSim仿真界面
' M) ^3 h+ J% y( R7 s2 A1 E$ y4 F( ^

/ a$ ?/ n( \8 d' T7 F2 W
6 f; ~) @1 E1 Y1 Q6 o
+ T. K# ~/ z; e, O; e6 W# Q0 J2 p2 u1 ?- M" m& x8 H

3 I/ @6 R1 R* G' A5)工程文件以及引脚说明如下:
! H7 c3 o7 x8 B) W3 v+ ^8 _) `: e, U) V( O
  • /*
  • * 功能描述:串口接收/发送程序(收到什么发什么)
  • * 开发板:EP2C5T144C8N核心板
  • * System pins:
  • * RST PIN_144
  • * CLK PIN_17 时钟输入(外部50MHz晶振)
  • * LED1 PIN_3 (低电平点亮)
  • * LED2 PIN_7 (低电平点亮)
  • * LED3 PIN_9 (低电平点亮)
  • *
  • * User pins:
  • * Txd PIN_43
  • * Notes:
  • * 波特率 9600
  • * 校验位 奇/偶校验
  • *
  • * by Pang 2018.11
  • */
  • 工程文件列表:
  • │  CleanProject.bat
  • │  uart_top.done
  • │  uart_top.qsf
  • │  uart_top.qws
  • │  uart_top_nativelink_simulation.rpt
  • │  uart_tx.flow.rpt
  • │  uart_tx.map.rpt
  • │  uart_tx.map.summary
  • │  uart_tx.qpf
  • │  uart_tx.qsf
  • │  uart_tx.qws
  • ├─db
  • │      logic_util_heursitic.dat
  • │      prev_cmp_uart_tx.qmsg
  • │      uart_top.db_info
  • │      uart_top.ipinfo
  • │      uart_top.sld_design_entry.sci
  • │      uart_top.tmw_info
  • ├─output_files
  • ├─simulation
  • │  └─modelsim
  • │          uart_top.vt
  • └─src
  •        uart_bps.v
  •        uart_rx.v
  •        uart_rx_bps.v
  •        uart_rx_state.v
  •        uart_state.v
  •        uart_top.v
  •        uart_tx.v
  •        uart_work.v
  •        water_led.v
    # L' Y( V- V! D
   
5 o9 X$ v& H' U, [" `
$ E5 k+ t0 K: _1 q. I( D

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发表于 2020-3-4 17:32 | 只看该作者
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发表于 2022-9-15 15:46 | 只看该作者
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