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想咨询一下Xilinx FPGA如何将UCF转换成XDC

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  • TA的每日心情

    2019-11-19 15:32
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
    发表于 2019-12-9 18:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    xilinx k-7系列FPGA,有一段基于ISE14.7的程序,想在Vivado上使用。
    + I! W0 e( v  y+ s那如何将ucf格式改成xdc格式。" t" v3 Q" [+ n% I" F
    除了转换引脚,还需要别的工作么?

    " J# w. X; {3 a

    该用户从未签到

    2#
    发表于 2019-12-9 19:55 | 只看该作者

    8 m0 n9 H4 s/ S% W2 y/ E7 Z: Q/ u. H, b8 e# Y8 h

    ! M! P9 c: `, x" F9 T
    [url=]1[/url]

    1 ^, W; J* s% z01. 先说引脚分配的转换:UCF转XDC
    ( u2 P4 H- `: b/ V; Y" ]* M    事实上,此转换需要的是将ISE的引脚分配*.csv导出,然后在vivado里导入引脚分配*.csv。. S; L! r' G' h: i: j; V
        具体步骤:) o7 ^5 ]6 T6 _9 Z3 V2 k  Z) }
        ①ISE导出*.csv
    ' M, }3 B$ s. ~6 C    a.  ISE工程,Tools -> PlanAhead -> Pre-Synthesis,打开PlanAhead。
    5 j! s* c* V$ d* d0 j& j    b.  在下方“I/O Ports”对话框的空白处右键,选择“Exprot I/O Ports”。
    4 ?& b2 R& \. d& N$ Q* D0 w    c.  弹窗勾选“CSV”,选择好保存路径,OK。这样完成了*.csv的导出。
    + S* t+ X7 `* E; ^3 M' ]    ②Vivado导入*.csv
    5 j* u6 }1 m" h    a.  导入*.v源文件和*.xci(IP核),搭好工程框架,升级IP核。如果有PS还需要配置好软核。/ H# J/ ^: b9 \0 p! Z3 D( _! [2 Y
        b.  运行综合Run_Synthesis,然后打开综合Open_Synthesized_Design。(无需XDC)
    4 l( v! W5 o( M$ j$ N    c.  Window -> I/O_Ports,打开引脚分配对话框。# t( @' ]4 y2 }6 n, W
        d.  File -> Import_I/O_Ports,弹窗选择CSV_File,找到刚才保存的*.csv即可。* R8 C+ x9 `9 }( ?3 z3 H, M
       
    # n# c& z$ k! n+ v2 C4 d$ l7 B02. 其他工作   
      `+ ?: k/ N+ O    a.  其他工作主要是Vivado的开发流程。: K* N, N; r* }) D; N
        b.  如果在综合的过程中报错,首先检查IP核是否升级。
    1 |: S3 J9 b" f6 z. O1 r        选中Project_Manager,然后在菜单栏选择Tools -> Report -> Report IP Status,检查IP状态。3 m/ d# b) k! k/ `+ M
        c.  不报错就没有问题了。如果再有问题的话一般是语法的细节问题,需要仔细检查。
    9 t: ~2 P0 s- ]/ G% B6 g

    " j  n  p: Z, B% @" b3 {1 s% x6 g3 p/ c; I6 f
    # G# l0 q3 y. i7 L9 x% J% s. V

    该用户从未签到

    3#
    发表于 2019-12-9 19:55 | 只看该作者
    目前在ISE和Vivado中,暂不支持UCF和XDC的互换
    4 Z8 a' ^1 @- M1 g7 Y如果不嫌麻烦并且感兴趣,可以自行编辑脚本或者EXCEL进行语法替换实现二者的转换。' Q9 p! I! Z# S* A/ M2 n
    脚本的主要工作就是语法替换。
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