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AD14制作封装警告有额外的引脚

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zanggg
  • TA的每日心情
    开心
    2023-5-10 15:19

    • 签到天数: 120 天

    [LV.7]常住居民III
    跳转到指定楼层
    1#
    发表于 2019-10-14 16:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    做了一个封装，警告说有额外的引脚[Warning]        数字逻辑.SchLib        Compiler        Extra Pin SN74LVC1G66DBV-1 in Normal of part SN74LVC1G66DBV2 X+ o6 k0 Z, C$ X4 ^1 G
    仔细看了下，原理图封装文件里没有额外的引脚，PCB封装文件里也没有多余的引脚9 z) ]5 u; `. \) S  t
    求教这个警告怎么消除。
    0 B* k$ ~3 S$ F4 G  h$ M

    微信图片_20191014163358.png (90.19 KB, 下载次数: 1)

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    EDA365微信号及QQ群号！
    yxlk

    该用户从未签到
    2#
    发表于 2019-10-14 18:38 | 只看该作者
    是有悬空的吗

    点评

    zanggg
    你说的悬空是什么意思？  详情 回复 发表于 2019-10-14 19:06

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    zanggg
  • TA的每日心情
    开心
    2023-5-10 15:19

    • 签到天数: 120 天

    [LV.7]常住居民III
    3#
     楼主| 发表于 2019-10-14 19:06 | 只看该作者
    yxlk 发表于 2019-10-14 18:38
    : Q* F( h. V0 ~( o0 W是有悬空的吗
    $ l4 I& f# Y+ }: O+ m$ t
    你说的悬空是什么意思？

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    fox_gale
  • TA的每日心情
    奋斗
    2025-8-4 15:30

    • 签到天数: 1243 天

    [LV.10]以坛为家III
    4#
    发表于 2019-10-15 07:28 | 只看该作者
    你是不是在原来好几路运放的封装上改来的？看警告是有part 你查一下

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    yihafewu

    该用户从未签到
    5#
    发表于 2019-10-15 10:42 | 只看该作者
    9 J4 }1 [" o: |& r( f
    点击mode，把下面除了normal外的其他都删了（点击右侧的减号进行删除）。% h: u5 x. D8 l2 C; @! U
    保存，更新当前封装到原理图，即可。+ W& M$ t, z7 [2 v9 Y0 |

      u! d$ i9 \( K9 a+ U

    点评

    zanggg
    谢谢，你的方法可行，早上我找到问题了，发现是封装不同模式下的pin脚号和名称对不上。修改后就正常了。  详情 回复 发表于 2019-10-15 12:17

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    zanggg
  • TA的每日心情
    开心
    2023-5-10 15:19

    • 签到天数: 120 天

    [LV.7]常住居民III
    6#
     楼主| 发表于 2019-10-15 12:17 | 只看该作者
    yihafewu 发表于 2019-10-15 10:42
      f  K! N: M8 t, ?) l' ^6 ]点击mode，把下面除了normal外的其他都删了（点击右侧的减号进行删除）。0 b9 G6 a6 t/ ^
    保存，更新当前封装到原理图， ...
    0 t" ^. }% U2 k, p, G  v6 K
    谢谢，你的方法可行，早上我找到问题了，发现是封装不同模式下的pin脚号和名称对不上。修改后就正常了。
    ; D) h6 C& I/ N4 E$ x$ v6 b

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