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[Cadence Sigrity] 时钟抖动jitter

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1#
发表于 2019-9-15 22:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如果时钟发生畸变,是否影响时钟抖动分析?1 g9 O2 M8 j5 _  s. |% H

该用户从未签到

2#
发表于 2019-9-16 09:23 | 只看该作者
畸变是什么意思

点评

比如信号上升沿信号畸变,不平滑  详情 回复 发表于 2019-9-16 23:08
  • TA的每日心情
    开心
    2025-3-7 15:07
  • 签到天数: 456 天

    [LV.9]以坛为家II

    3#
    发表于 2019-9-16 09:44 | 只看该作者
    源頭都有問題了,當然會影響啊~
      W% k& J/ L0 b# ?) y

    该用户从未签到

    4#
     楼主| 发表于 2019-9-16 23:08 | 只看该作者
    Lukezhang 发表于 2019-9-16 09:23
    , n+ H7 S1 {4 l) ]畸变是什么意思

    , X1 [/ P1 q$ ~5 [$ ^5 ?& T& P) G比如信号上升沿信号畸变,不平滑
    3 B3 ]; n5 N9 R# T

    该用户从未签到

    5#
    发表于 2019-10-13 12:06 | 只看该作者
    出现畸变,那就是PLL环路的基本电路问题,不能单纯的说是抖动了。抖动的定义是保证PLL环路稳定性的前提下测试非理想因子对时钟的影响。
  • TA的每日心情
    开心
    2019-11-20 15:01
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
    发表于 2019-11-16 16:38 | 只看该作者
    说说应用场景啊
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