本站微信 收藏本站 设为首页
 找回密码
 注册
关于网站域名变更的通知
EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › 基于VMM的L2 Cache的验证平台的设计与实现
返回列表 发新帖
查看: 397|回复: 2
打印 上一主题 下一主题

基于VMM的L2 Cache的验证平台的设计与实现

[复制链接]
Taio

该用户从未签到
跳转到指定楼层
1#
发表于 2019-8-30 09:41 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录！

您需要 登录 才可以下载或查看，没有帐号？注册

x
基于VMM的L2 Cache的验证平台的设计与实现

0 W: e2 ~8 @6 u% s6 g/ Z( _# |1 z  Y
提出一种由system Verilog语言搭建的基于VMM的一种面向对象的验证平台。该验证平台主要使用覆盖率驱动的验证技术,并结合可约束随机测试和记分板技术,对一款多核处理器芯片中的L2 Cache进行功能验证。4 K' S- t5 I% o9 V* U
游客，如果您要查看本帖隐藏内容请回复

下载资料威望不够？点击查看获取威望的N种方法>>
回复

举报

EDA365微信号及QQ群号！
雷北城

该用户从未签到
3#
发表于 2022-4-2 14:05 | 只看该作者
基于VMM的L2 Cache的验证平台的设计与实现

下载资料威望不够？点击查看获取威望的N种方法>>
回复 支持 反对

举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-7-29 06:06 , Processed in 0.125000 second(s), 26 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表