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FPGA-17-xilinx_zynq7000_EPP上一个简单实验(PS+PL)(上)

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发表于 2019-8-19 14:42 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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引言
- o& G! R; ^2 O, [. h
2 f% {2 Y* u$ O, n$ G

" d4 n. |% C7 P) k; [& I前面两个实验,PL是传统的FPGA开发,PS是传统的嵌入式开发。6 j2 ]6 j" m0 e6 `- j, ~% s
/ }2 s4 y/ ~2 j7 [, R: }. k/ I
' o' D  \8 Q2 ^# W, @; Y
zynq7000EPP是xilinx比较高端的FPGA开发板,XC7Z020内部集成了两个cortexa9的硬核,外部有1G的DDR3,所以单纯做FPGA太浪费了。但是单纯用PS资源,就没必要用FPGA了,所以只有将两者结合使用才能体现其价值所在。
  @& a$ N* X# v) f: V8 @1 I% P2 Y8 |3 r: [2 [& g+ G8 k' H; H  X
1 y7 X% k$ L5 I7 a* G
即,PS+PL。添加自己的一个IP到AXI总线上,然后通过SDK编码控制它的寄存器,这就是本小节的实验内容。
' o$ b2 i8 j2 E& \+ k/ J
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: l- |4 n4 a4 X9 i: e; y. P1 a+ v+ T$ L1 a& L& i

2 I. x( i( T3 g2 S1 实验目的
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9 H5 b1 N3 B4 v* S) x7 z+ \3 G( x2 N

1 J3 e) P. i/ K' Z5 }6 v" q- [$ X
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发表于 2019-8-19 18:08 | 只看该作者
看看什么东东。
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