基于FPGA的SoftSerdes设计与实现

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基于FPGA的SoftSerdes设计与实现

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在高速源同步应用中，时钟数据恢复是基本的方法。最普遍的时钟恢复方法是利 用数字时钟模块(DCM)产生的多相位时钟对输入的数据进行过采样。但是由于DCM的固 有抖动，在频率很高时，利用DCM作为一种数据恢复的方法并不一定合适。DCM的这种 附加抖动会引起数据有效窗口的相应减小，这样就会限制高速电路的性能。常用的串 行I／O技术需要时钟数据恢复(CDR)技术，而CDR技术需要模拟的PLL，其局限性是低噪 声容限、高功率损耗及严格的PCB布局布线要求。基于对上述缺点的考虑，本文介绍了 一种异步数据捕获技术，它不使用DCM就可以实现数据恢复，所以能获得更高的速度和 性能。

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