多分辨率图像实时采集系统的FPGA逻辑设计

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多分辨率图像实时采集系统的FPGA逻辑设计

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随着数字多媒体技术的不断发展，数字图像处理技术被广泛应用于可视电话、电 视会议、监控系统等各种民用、商用及工业生产领域中。但在这些数字图像处理系统 中，一个突出的问题就是数据量庞大，特别是在图像帧率及分辨率要求比较高的场合 下，仅用专用的视频压缩芯片（Video ASIC）、专用的视频信号处理器(Video DSP)或 通用的高性能数字信号处理芯片（DSP），均无法获得令人满意的效果。为此，人们提 出了多种解决方案，其中比较有代表性的方案有以下两种： 　
　
一是在中央控制器的调度下，两片或多片图像处理主芯片并行对图像进行处理。
　　
. T0 b$ d9 |8 t# B8 y二是整个图像处理系统由图像采集系统和图像压缩系统组成，其中图像采集系统 负责接收原始的图像数据并对其进行一定的预处理；图像压缩系统负责接收图像采集 系统预处理后的数据并进行压缩。 　　

2 P& |" |. m$ @& M- m5 \% g本文将基于第二种方案，分析其中图像采集系统的控制逻辑设计思想；并结合图 像压缩算法的需求，着重介绍图像数据预处理的控制流程及实现方法；最后通过实 验，对预处理前后图像处理系统的效率进行比较分析。
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