改进型CIC抽取滤波器设计与FPGA实现

Taio · 发表于 2019-8-9 09:33

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改进型CIC抽取滤波器设计与FPGA实现

摘要：为了改善级联积分梳状(CIC)滤波器通带不平和阻带衰减不足的缺点，给出一种改进型CIC滤波器。该滤波器在采用 COSINE滤波器提高阻带特性的基础上，级联了一个SINE滤波器，补偿了其通带衰减。硬件实现时，采用新的多相分解方法结合非递归结构，不仅大大减少了存储单元数量，还使电路结构更加规则。经仿真和FPGA验证，改进型CIC滤波器使用较少硬件，实现了阻带衰减100．3 dB，通带衰减仅为O． 000 1 dB 。

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yxlk · 发表于 2019-8-9 17:18

谢谢分享

雷北城 · 发表于 2022-6-10 15:32

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