关于网站域名变更的通知

EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › 在Crosslink的MCLK频率中设置48MHz的MCLK频率，为什么还 ...

发新帖

查看: 303|回复: 1

上一主题

下一主题

在Crosslink的MCLK频率中设置48MHz的MCLK频率，为什么还是24 MHz？？？

该用户从未签到

电梯直达

跳转到指定楼层

1^#

发表于 2019-8-8 14:39 | 只看该作者回帖奖励

回帖奖励

|倒序浏览 |阅读模式

EDA365欢迎您登录！

您需要登录才可以下载或查看，没有帐号？注册

x

在Crosslink的MCLK频率中设置48MHz的MCLK频率，为什么还是24 MHz？

收藏0 淘帖0 支持！0 反对！0

下载资料威望不够？点击查看获取威望的N种方法>>

回复

EDA365微信号及QQ群号！

该用户从未签到

2^#

发表于 2019-8-8 18:22 | 只看该作者

时钟频率设置为48 MHz，但时钟分频器始终需要设置为2分频，这意味着实际频率时钟仅为24 MHz。是不是硬件有缺陷啊

下载资料威望不够？点击查看获取威望的N种方法>>

回复支持反对

发新帖

推荐内容 /1

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-8-12 23:25 , Processed in 0.125000 second(s), 23 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表