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LATTICE FPGA ECP5如何锁定设备上的serdes引脚???

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  • TA的每日心情

    2019-11-19 15:34
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
    发表于 2019-8-7 15:48 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    LATTICE FPGA ECP5如何锁定设备上的serdes引脚?设计器规划器中没有引脚锁定功能。。针脚呈灰色。
    . Y* J- D) r0 Q( |6 x7 f4 V/ T# @
    ; {3 \7 q0 v- oSERDES引脚自动锁定到专用引脚,用户无法锁定,用户只能找到PCS实例,例如:LOCATE COMP“u1_ecp3pcs / pcsd_inst”SITE“PCSA”;
    # ~7 O) X( j. a1 L

    该用户从未签到

    2#
    发表于 2019-8-7 17:57 | 只看该作者
    看我找的这个答案能不能用6 G6 d7 X3 s8 D2 s

    # S; s0 R# O* X1 P, v0 E% ?$ _

    6 ^: x9 t4 d4 B+ Q3 b3 Uecp5是可以的,如下图我用的ecp5型号是LFE5UM-25F,里面只有一个DCU,如下图所示为未锁定前的
    6 _7 h& Q5 O8 X* y8 v. @5 B
    + ^8 ]$ S6 c& y; G
    + c( s$ Y# F7 X" c! g3 c: [4 v( N按下图箭头所示将Lane0、Lane1以及EXTREF等参数拖入DCU对应位置中,锁定管脚
    ( k* |0 }' |1 I# J
    3 d1 W, W% o# K7 l# y( Y" |. F; L! L

    该用户从未签到

    3#
    发表于 2019-8-7 17:58 | 只看该作者
    ECP3跟ECP5不一样,ECP5有这个clarity,可以通过在planner里面拖动信号到视图中进行锁定,同时还可以进行管脚检查,在DDR3 MEM时经较好用。
    / x3 w0 E8 F, U0 X% w1 d: K: v* @# L( W
    ECP3的当你在IP里面选定serders所用端口时,它就固定了。基本上你看原理图就明白了,当然你也可以通过phy-view来查看。
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