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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › DS/FH混合扩频接收机解扩及同步技术的FPGA实现
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DS/FH混合扩频接收机解扩及同步技术的FPGA实现

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Taio

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1#
发表于 2019-7-31 09:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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DS/FH混合扩频接收机解扩及同步技术的FPGA实现
& v2 V9 d0 F2 `

# `; e" o4 t/ T5 J* G0 r" N4 f, c0 v8 v- ~
研究采用编码扩频的DS/FH混合扩频接收机的核心模块——同步及解扩部分的FPGA实现结构。将多种专用芯片的功能集成在一片大规模FPGA芯片上,实现了接收机的高度集成化、小型化。伪码的串并混合捕获算法及跳频同步算法等均采用硬件完成,提高了捕获速度。  F, V+ I6 L& c- c
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木棉花_MM

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2#
发表于 2019-7-31 17:42 | 只看该作者
学习一下咯

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雷北城

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3#
发表于 2021-10-6 10:40 | 只看该作者
DS/FH混合扩频接收机解扩及同步技术的FPGA实现

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