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基于Verilog HDL的电梯系统设计

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  • TA的每日心情
    开心
    2019-11-20 15:05
  • 签到天数: 2 天

    [LV.1]初来乍到

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    1#
    发表于 2019-7-29 07:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    & W6 f5 P: {8 E" {2 i) a
    从状态机的角度,介绍了一种电梯控制器的verilog HDL 设计方法,将其嵌入到FPGA中,用于实现电梯的控制,着重介绍了电梯的总体设计方案,详细描述其内部状态机的工作原理,并提供了电梯中主控制器与分控制器通信部分的verilog源代码,给出了在Xilinx公司的ISE6.2+ModelSIMXE5.6软件平台中进行EDA的综合结果与时序仿真,并遵循方向优先的原则提供3个楼层的载客服务并指示电梯的运行情况,实际应用表明,该系统设计灵活,运行可靠,成本低廉,有一定的应用价值! W' i- F, \9 J8 h1 y% O' y

    6 h' Q, j& S7 |5 Q  x
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