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发表于 2019-7-26 11:26 | 只看该作者回帖奖励

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请教大神，是否可以用Verilog实现硬件逻辑，提供寄存器接口由soc 用C语言访问，如果可以，如何实现？非常感谢！

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发表于 2019-7-26 14:43 | 只看该作者

不太清楚，帮顶

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TA的每日心情

	难过 2020-4-23 15:10

签到天数: 37 天

[LV.5]常住居民I

3^#

发表于 2019-7-29 08:29 | 只看该作者

应该可以的吧，不同的厂家应该由总线AXI，我认为是这样子的啊

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