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FPGA的灵魂 ---- 状态机

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发表于 2019-7-10 14:43 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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有关状态机的文章,事实上已经写过很多了,可是即使如此,真的懂了吗?真的能熟练应用吗?未必吧。这篇博文来源是《FPGA之道》,认真下看去收货颇丰!- _' t/ I! B" S, B" J

( i, K' K; G9 H& q, D# }% h

3 _* e& `7 @1 H. j6 _3 U借这个主题来梳理下状态机:5 F8 Y8 }5 C/ c( J
5 Q0 q2 Q6 Y! L9 L$ S

/ a7 F0 b4 Z" D- X+ E) w) C状态机简介: `* e0 L8 W: f1 z& S; Z7 t' X" r

2 k* L; k* c* ~/ Y2 v
" W* o0 K/ _/ N6 C" s
状态机是FPGA设计中一种非常重要、非常根基的设计思想,堪称FPGA的灵魂,贯穿FPGA设计的始终。
# q! A0 l  J' J# n2 n3 X/ l" S" V% X$ A1 B8 v  L$ f

, f1 o/ ?/ ?  p3 i% j简单地说,状态机就是一副描绘着状态变迁的状态转移图,它体现着系统对外界事件的反应和行为。: H; i5 A! g7 R+ D& z) n1 Y. e

* P7 O5 e, m1 y" `5 x  j

9 B) Y- d, {' X+ g2 X" T* F) p
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4 p, H( o* @; ~% d  X; r0 E1 Z6 O( w3 S
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