AD16的原理图导出ALLERO16.6能用的网表

zpf153387889 · 发表于 2019-7-10 11:37

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各位大神AD16的原理图怎么导出ALLERO16.6能用的网表

yihafewu · 发表于 2019-7-10 11:58

原理图中元件封装名要与Allegro的封装名一致
导出网络表时选择Telesis
用记事本打开该网表，在所有封装前加英文状态下的感叹号“!”。（在AD填封装名时就添加“!”是否可以？）
让所有Allegro封装生成Device文件（打开对应封装文件，File->Create Device）
Allegro导入网表时，选择other项。

zpf153387889 · 发表于 2019-7-10 14:10

yihafewu 发表于 2019-7-10 11:58
5 m. d; j/ O" e! R/ I& L& M原理图中元件封装名要与Allegro的封装名一致" v8 M3 i( u8 ~" v
导出网络表时选择Telesis4 E* `7 U& L/ E/ S3 {
用记事本打开该网表，在所有封装前 ...

大神导入时提示有非法字符，哪些是属于非法字符呢？

yihafewu · 发表于 2019-7-10 14:34

cadence有很多字符是不认的，例如空格、小数点、斜杠、星号、井号等。

zpf153387889 · 发表于 2019-7-10 14:39

谢谢指点！

Tony_zhang · 发表于 2019-7-10 16:29

yihafewu 发表于 2019-7-10 14:347 d( @4 C9 A! X3 f; {1 h4 H6 X
cadence有很多字符是不认的，例如空格、小数点、斜杠、星号、井号等。

解读很准确！

這侽孓譙悴丶 · 发表于 2019-7-11 10:35

yihafewu 发表于 2019-7-10 11:589 P( ^/ l+ B, w' z8 c/ d7 r; \' J9 r
原理图中元件封装名要与Allegro的封装名一致
0 w5 }! l6 k" T) H) L导出网络表时选择Telesis
/ }; S2 H& V+ G0 E" b用记事本打开该网表，在所有封装前 ...

手动编辑的方法。也可以去Skill开发版块下载一个Protel格式网表转换Allegro格式网表的Skill就方便些了，自动转换！

https://www.eda365.com/thread-30201-1-3.html

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