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基于Verilog的一种高效验证平台的研究及应用

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发表于 2019-7-5 09:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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基于Verilog的一种高效验证平台的研究及应用

; m0 l! P: r# ?4 v3 k7 a
8 W. g( H6 F8 v$ v  J: _
; A  W& D0 o; s7 l1 n2 [摘 要:文章讨论了墓于Ve r i l o g验证平台的功能、 组成、 关健设计技术及优化几个方面的问题, 并在此墓础上用 Ve r i l o g HDL建立了高效的自检查验证平台一 , 实现了被测模型的输出与期望输出的自动比较。9 M/ l, b5 l( p+ D/ Q' a
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2#
发表于 2019-7-5 17:45 | 只看该作者
看看,谢谢分享

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发表于 2022-2-22 14:58 | 只看该作者
基于Verilog的一种高效验证平台的研究及应用
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