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[仿真讨论] 差分线间距由什么因素确定?

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1#
发表于 2019-7-1 09:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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差分线间距由哪些因素决定呢。# h- x5 ]/ n% a4 m3 l
' S+ [# E2 c4 k' B; W
1、BGA球栅间距所决定的布线通道宽度(BGA球栅间距减去过孔焊盘直径,还能走差分线);
9 p" L3 E" u) \: l4 T- d还是:- C" l# P) r' ]
2、PCB蚀刻精度决定最小间距。- O$ E9 K# S+ P' H

$ d  F' J! B2 x8 G
; |" |, i5 q' }' m; D$ n  T  Q2 n我的意思是,如果确定差模阻抗100欧,就不需要再去确定共模阻抗、偶模阻抗吧。* l/ N3 J. u9 N$ t5 r1 w* G
6 \2 ~! y) W6 D7 k
而只是由工程上的物理实现能力决定差分线间距,对吗?2 `" v; L* s& r4 ]! B: X* T

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3#
发表于 2019-7-1 11:09 | 只看该作者
你可以看看si9000 就知道怎么算了

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5#
发表于 2019-7-1 11:30 | 只看该作者
怎么确定间距

点评

有一些经验值可参考,一般做紧耦合,间距小于2倍线宽  详情 回复 发表于 2019-7-1 16:59

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6#
发表于 2019-7-1 14:48 | 只看该作者
有个问题请教一下,控差分阻抗的时候需要先控单线的50欧姆阻抗吗?之前算的时候一直没有注意单线阻抗,好像也没什么问题

点评

不需要,看阻抗要求,一般特殊信号或者速率高的信号线需要控制阻抗,之前的单线没问题,说明速率很低,直接计算差分线阻抗就可以了  详情 回复 发表于 2019-7-1 16:54
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    [LV.3]偶尔看看II

    7#
    发表于 2019-7-1 16:54 | 只看该作者
    xian2006 发表于 2019-7-1 14:480 U. ]% D5 l, s$ P5 M6 x7 \
    有个问题请教一下,控差分阻抗的时候需要先控单线的50欧姆阻抗吗?之前算的时候一直没有注意单线阻抗,好像 ...

    / Q1 R4 Z8 ]* V不需要,看阻抗要求,一般特殊信号或者速率高的信号线需要控制阻抗,之前的单线没问题,说明速率很低,直接计算差分线阻抗就可以了* K7 \1 u4 O/ @+ M

    该用户从未签到

    8#
    发表于 2019-7-1 16:59 | 只看该作者
    高速线都应该按传输线控制阻抗!
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    9#
    发表于 2019-7-1 16:59 | 只看该作者
    zyxiaokiss 发表于 2019-7-1 11:30* d0 `/ _4 N/ B$ c% `! o; s
    怎么确定间距

    ! y/ B$ b5 e% [  {有一些经验值可参考,一般做紧耦合,间距小于2倍线宽
    " s+ C: }9 m. C7 a7 O4 P6 v& ]
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    12#
    发表于 2019-7-11 13:34 | 只看该作者
    主要由阻抗决定, 跟参考层的厚度,介质层材质有关

    该用户从未签到

    13#
    发表于 2019-7-18 15:22 | 只看该作者
    既然决定了走差分线,那差分间距的主要影响因素有PCB布线空间,还有一个耦合度的要求,有的协议上是有耦合度要求的,没有耦合度要求的一般也会选择差分间距小一点,抗干扰能力会强
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