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Verilog HDL 为什么会说数据流描述也是一种行为描述???

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1#
发表于 2019-6-28 13:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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陈赜主编的《cpld/FPGA与ASIC设计实践教程》一书中,
/ w1 W0 q$ `, ~5 @5 }6 y
# R' ^6 l6 a5 E* u8 A! X& }+ n
刚开始说的描述方式有四种,即结构描述,数据流描述,行为描述以及三者混合方式,,
! Q# `, \6 \; f( j3 X( j/ Q0 ^, x, T( u$ ~* Y
1 a$ N0 E9 {# C- |8 d7 \
但是在第五章行为描述中又讲到数据流描述也是行为描述,将数据流描述和行为描述统称为行为描述。。
* @1 R. B( U: C5 t4 v& Q! Z- M  j$ m' G. R0 v

8 q4 B/ p/ b* F! W' p2 L' ]4 p  ]请问这数据流和行为描述到底有什么关系,对于后者的说法该怎么理解???! f& p. k0 a8 a% Q: K
( {9 z. F* c2 |

该用户从未签到

2#
发表于 2019-6-28 17:01 | 只看该作者
这有有些矛盾吧
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