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关于1.0间距BGA内走差分线

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1#
发表于 2019-6-26 20:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请教各位大神,1.0间距BGA内走差分线,要求100欧阻抗,多少线宽和间距能满足要求。
- e4 V- Y# B( C$ B1 Y) r
  • TA的每日心情
    慵懒
    2025-8-20 15:18
  • 签到天数: 103 天

    [LV.6]常住居民II

    2#
    发表于 2019-6-27 09:11 | 只看该作者
    材料、叠构、介电、内层外层、。。。。都没说明 ,就不好确定了
    / b) |5 `/ t* R
    ( w5 F7 ^: X- e7 W/ o

    该用户从未签到

    3#
     楼主| 发表于 2019-6-27 21:55 | 只看该作者
    S1000-2M板材,层数还没确定12层或14层。板厚在2mm,其他没特殊要求
    & G8 ~6 C& {1 E  u

    该用户从未签到

    4#
    发表于 2019-6-29 01:50 | 只看该作者
    为满足可制造性,应该以走线到孔孔壁间距为优先设计约束,一般用0.1毫米线宽/线距就可以。2mm板厚,12层我估计很难满足100欧姆要求。除非相邻层开窗,或用特别的层堆叠设计。

    该用户从未签到

    6#
    发表于 2019-7-2 13:57 | 只看该作者
    对,问版厂。或者走内层吧
  • TA的每日心情
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    2024-11-1 15:35
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    [LV.1]初来乍到

    7#
    发表于 2019-7-2 17:06 | 只看该作者
    :lol看看,可以忽略阻抗,BGA内部:lol
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